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安富利X-fest 2014:展現(xiàn)設(shè)計(jì)方案加速設(shè)計(jì)工程師的成功
安富利(Avnet)X-fest 2014亞洲區(qū)研討會(huì)從11月4日在北京正式拉開(kāi)帷幕,作為值得信賴(lài)的業(yè)界領(lǐng)袖,安富利借助此兩年一度的盛會(huì),為FPGA、SoC、DSP 和嵌入式系統(tǒng)設(shè)計(jì)工程師們提供實(shí)用的技能培訓(xùn),造福全球的設(shè)計(jì)工程群體。
2014-12-11
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FPGA有門(mén)道?一款軟件無(wú)線電平臺(tái)的設(shè)計(jì)
自軟件無(wú)線電出現(xiàn)至今,是無(wú)線電通信從硬件到軟件、從模擬到數(shù)字、從固定到移動(dòng)的三次技術(shù)變革。軟件無(wú)線電通俗地講就是基于通用硬件平臺(tái),通過(guò)軟件提供多種服務(wù)、適應(yīng)多種標(biāo)準(zhǔn)、多頻帶多模式、可重構(gòu)可編程的無(wú)線電系統(tǒng)。下面給大家詳細(xì)解說(shuō)這款基于FPGA的軟件無(wú)線電平臺(tái)的設(shè)計(jì)。
2014-11-14
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美高森美發(fā)布全新安全特性,為業(yè)界提供最安全的FPGA器件
美高森美公司宣布提供新型超安全SmartFusion2 SoC FPGA和 IGLOO2 FPGA器件,安全特性在器件、設(shè)計(jì)和系統(tǒng)層次上提升了主流應(yīng)用的保護(hù)功能。
2014-10-16
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利用CPLD數(shù)字邏輯和FPGA實(shí)現(xiàn)ADC
用CPLD和FPGA在印制電路上將功能元件和存儲(chǔ)器、處理器粘合以其實(shí)現(xiàn)數(shù)字設(shè)計(jì)是工程師的強(qiáng)項(xiàng)。除了這項(xiàng)功能,CPLD和FPGA能夠使用簡(jiǎn)單的電阻電容電路、CPLD或者FPGA數(shù)字邏輯單元、LVDS輸入來(lái)實(shí)現(xiàn)共模功能,構(gòu)建數(shù)模轉(zhuǎn)換器。ADC在與數(shù)字邏輯連接時(shí)作為模擬功能塊存在。本文中詳細(xì)解析了利用FPGA和CPLD數(shù)字邏輯實(shí)現(xiàn)低頻率(DC至1K Hz)和高頻率(高達(dá)50K Hz)ADC。根據(jù)實(shí)例驗(yàn)證語(yǔ)音通信系統(tǒng)中的頻率檢測(cè)。
2014-10-12
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基于FPGA的航空電子系統(tǒng)的設(shè)計(jì)
基于可編程門(mén)陣列FPGA的核心技術(shù)實(shí)現(xiàn)航空電子系統(tǒng)的設(shè)計(jì),提高了集成度,降低功耗,減小體積,提高平均間隔時(shí)間,降低設(shè)計(jì)風(fēng)險(xiǎn),MIL-STD-1553 的市場(chǎng)隨著這項(xiàng)技術(shù)的實(shí)現(xiàn)也變得繁榮起來(lái)。MIL-STD-1553 核心的種種優(yōu)勢(shì),使 ASIC 傳統(tǒng)徹底退出歷史舞臺(tái)。FPGA 核心技術(shù)如同強(qiáng)心劑,賦予系統(tǒng)不同的特性,給 MIL-STD-1553 的設(shè)計(jì)帶來(lái)了諸多優(yōu)勢(shì)。
2014-10-11
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設(shè)計(jì)分享:建立在SmartModule上的雷達(dá)嵌人式計(jì)算機(jī)
現(xiàn)代雷達(dá)計(jì)算機(jī)要求具備功能強(qiáng)、體積小、易維護(hù)得特點(diǎn),為適應(yīng)社會(huì)發(fā)展需要,本文中提出了一種采用SmartModule模塊、大規(guī)模FPGA和專(zhuān)用集成電路制作而成的雷達(dá)嵌入式計(jì)算機(jī)。這個(gè)系統(tǒng)具備系統(tǒng)組成結(jié)構(gòu)簡(jiǎn)單、組成板卡少、數(shù)據(jù)交換率高、可靠性高、單板功能強(qiáng)、可擴(kuò)展性強(qiáng)、成本低的特點(diǎn)。
2014-10-10
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詳解密碼芯片設(shè)計(jì)中的反熔絲FPGA
反熔絲FPGA對(duì)于大多數(shù)設(shè)計(jì)可提供實(shí)現(xiàn)較好的性能,這是由于其可編程鏈路的電阻較小(反熔絲接點(diǎn)電阻50Ω左右),具有較好的 布線靈活性,不會(huì)妨礙信號(hào)傳送,并以最直接的通路進(jìn)行,因而可大大提高芯片速度。
2014-10-09
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創(chuàng)新技術(shù):在FPGA上實(shí)現(xiàn)3D圖像處理器IP核
目前,嵌入式系統(tǒng)數(shù)字化產(chǎn)品成為繼PC機(jī)后的信息處理工具。隨著嵌入式技術(shù)的發(fā)展,圖形處理也從2D圖形向3D圖形轉(zhuǎn)變。本文采用OpenGL作為系統(tǒng)的圖形API,選取21條基本API命令,定義命令字編碼和渲染列表格式作為IP核的設(shè)計(jì)規(guī)約。
2014-10-08
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技術(shù)解析:在FPGA上利用Python 實(shí)現(xiàn)定點(diǎn)平方根
作為可編程的邏輯器件,FPGA便于調(diào)試、修改、功耗低,能夠完成大量算法。在處理圖像和信號(hào)時(shí)平方根運(yùn)算被廣泛使用。在FPGA上利用VHDL和Verilog等編程語(yǔ)言進(jìn)行硬件設(shè)計(jì),存在仿真和校驗(yàn)效率低、算法復(fù)雜等問(wèn)題。而Python以其簡(jiǎn)單、功能強(qiáng)大的特點(diǎn)在此次設(shè)計(jì)中起到關(guān)鍵作用。
2014-10-07
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技術(shù)分享:基于FPGA的水聲信號(hào)采集與存儲(chǔ)系統(tǒng)設(shè)計(jì)
本文為實(shí)現(xiàn)對(duì)水聲信號(hào)的多通道同步采集并存儲(chǔ),提出了基于FPGA的多通道信號(hào)同步采集、高速大容量實(shí)時(shí)存儲(chǔ)的系統(tǒng)設(shè)計(jì)方案,并完成系統(tǒng)的軟硬件設(shè)計(jì)。該系統(tǒng)的硬件部分采用模塊化設(shè)計(jì),通過(guò)FPGA豐富的外圍接口實(shí)現(xiàn)模塊間的數(shù)據(jù)交互,軟件部分采用Verilog HDL硬件描述語(yǔ)言進(jìn)行編程,能夠靈活的實(shí)現(xiàn)信號(hào)的采集及存儲(chǔ)。實(shí)際應(yīng)用表明,該設(shè)計(jì)具有功耗低,可高速實(shí)時(shí)存儲(chǔ),存儲(chǔ)容量大,通用性強(qiáng),易于擴(kuò)展升級(jí)等特點(diǎn)。水聲信號(hào)采集存儲(chǔ)系統(tǒng)是海洋環(huán)境調(diào)查儀器的重要組成部分。開(kāi)展水聲環(huán)境調(diào)查所使用的海洋儀器要求設(shè)備通道多、同步性好、采樣率高、數(shù)據(jù)存儲(chǔ)容量大。
2014-09-29
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基于FPGA的電容在線測(cè)試系統(tǒng)設(shè)計(jì)
本文研究了一種可行的、簡(jiǎn)單實(shí)用及高精度的電容在線測(cè)試電路。隨著EDA技術(shù)的快速發(fā)展,FPGA以其高集成度、高可靠性及靈活性等特點(diǎn)正在快速成為數(shù)字系統(tǒng)開(kāi)發(fā)平臺(tái),在多種領(lǐng)域都有非常廣闊的應(yīng)用前景。本設(shè)計(jì)結(jié)合上述兩特點(diǎn),設(shè)計(jì)了一種基于向FPGA內(nèi)植入Nios II嵌入式軟核作為控制器的電容在線測(cè)試電路。
2014-09-28
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設(shè)計(jì)分享:采用上位機(jī)與FPGA開(kāi)發(fā)板的光纖通道接口適配器設(shè)計(jì)
存儲(chǔ)技術(shù)的日新月異推動(dòng)了存儲(chǔ)容量的迅速增長(zhǎng),存儲(chǔ)系統(tǒng)的數(shù)據(jù)傳輸速度成為阻礙。光纖的傳輸在速度上存在優(yōu)勢(shì),然而,在光纖傳輸被光纖通道接口限制,因此接口的設(shè)計(jì)成為光纖通道應(yīng)用于高速數(shù)據(jù)傳輸?shù)囊粋€(gè)關(guān)鍵技術(shù)所在,本文對(duì)有效地解決高數(shù)據(jù)傳輸在接口處的瓶頸具有現(xiàn)實(shí)意義。
2014-09-23
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